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一個(gè)實(shí)體可以擁有一個(gè)或多個(gè)()
A.設(shè)計(jì)實(shí)體
B.結(jié)構(gòu)體
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D.輸出
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VHDL的進(jìn)程(process)語句是由()組成的,但其本身卻是()
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VHDL的順序語句只能出現(xiàn)在()、()、()中,是按照書寫順序自上而下,一條一條執(zhí)行。
答案:
進(jìn)程;過程;函數(shù)
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